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Master Thesis

Ordonnancement pour processeurs à parallélisme d'instructions en utilisant des techniques de recherche de motifs

Résumé : Dans le but de satisfaire les différentes contraintes matérielles, une exploration architecturale peut permettre de définir les paramètres optimaux d'un processeur VLIW (Very Long Instruction Word) pour une application donnée tels que le nombre d'unités fonctionnelles, le nombre de registres, etc. Les paramètres du processeur sont ajustés en fonction du niveau de parallélisme d'instructions de l'application. De la même manière, l'utilisation de jeux d'instructions spécifiques à une application est adaptée à une utilisation au sein des systèmes embarqués qui sont, dans la majeure partie des cas, dédiés à un traitement spécifique. Toutes ces spécialisations permettent d'améliorer efficacement le rapport entre performance, surface et consommation. Ce rapport présente un nouvel outil dont le but est de définir les paramètres optimaux d'un processeur de type VLIW pour une application donnée en termes de dimensionnement, d'organisation et de spécialisation de son jeu d'instructions. Cet outil repose sur la modélisation des problèmes à résoudre en utilisant la programmation par contraintes et exploite la technique de couverture de graphe à l'aide de motifs de calculs. Différentes structures de processeurs pourront alors être comparées en termes de performance et de complexité matérielle.
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Cited literature [19 references]  Display  Hide  Download

https://dumas.ccsd.cnrs.fr/dumas-00530793
Contributor : Co-Responsables Du Mri V. Gouranton Et S. Blazy <>
Submitted on : Friday, October 29, 2010 - 8:09:56 PM
Last modification on : Wednesday, May 16, 2018 - 11:23:29 AM
Long-term archiving on: : Sunday, January 30, 2011 - 3:08:48 AM

Identifiers

  • HAL Id : dumas-00530793, version 1

Citation

Hervé Yviquel. Ordonnancement pour processeurs à parallélisme d'instructions en utilisant des techniques de recherche de motifs. Architectures Matérielles [cs.AR]. 2010. ⟨dumas-00530793⟩

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